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第8章综合软件 Synplify Pro 及应用 Synplify Pro 简介 Synplify Pro 软件的特点 Synplify Pro 综合设计 十进制计数器 Synplify Pro 综合设计应用举例本章内容 Synplify Pro 简介综合是数字 EDA 设计中重要的组成部分,综合的作用是将用语言表示的 HDL 源程序转换成相应的门级电路网表。综合软件的优劣直接决定了电路功能的实现、电路所占资源的以及多少电路的各项性能是否符合要求等。虽然这一切跟 HDL 程序设计的优劣息息相关,但同样的设计经过不同的软件综合后可能有不同的结果,所以好的综合软件能带来事半功倍的效果。综合软件简介?目前主要的综合软件由以下几大 EDA 软件公司开发: Cadence 、 Synopsys 、 Synplicity 和 Mentor ? Cadence 的综合软件主要应用于 ASIC 设计,大多工作在工作站上? Synplify Pro 是 Synplicity 公司的 FPGA 综合软件,针对复杂可编程逻辑设计的 FPGA 综合工具? Synplify Pro 支持 Verilog HDL 和 VHDL 硬件描述语言, 支持各种 FPGA 厂商的 FPGA 产品 Synplify Pro 的特点?自动的时序优化技术?强大的综合技术?最优化编码方式的有限状态机开发技术?较高的流水线技术? EDA 设计功能强大支持 VerilogHDL 、 VHDL 及混合语言的设计自动识别 RAM Synplify Pro 提供了和布局布线工具之间的 native-link 接口 Synplify Pro 综合设计?逻辑综合设计流程如下图所示: Synplify Pro 综合设计流程?打开 Synplify Pro ?新建一个工程?添加 source file ?代码语法错误检查?综合选项设置?开始综合?综合结果输出以十进制计数器的逻辑综合设计为例: Synplify Pro (1)执行 FileNewProject File 操作新建一个工程, 并保存在 E\laoshi\systhesis 目录下,默认工程名为 2)也可执行如下操作新建一个工程点击操作按钮栏中的 Open Project ,弹出如图所示对话框,选择 New Project ,即可产生一个默认名字为 的工程,该工程的默认路径为 E\laoshi\systhesis 。