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南邮微机原理课件第8章.ppt


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第8章输入/输出系统 CPU 系统总线总线插槽 AB AB DB DB CB CB CPU 总线地址锁存缓冲器数据锁存缓冲器总线控制逻辑 I/O 接口存储器系统 I/O 接口 H PC 系列微机系统采用开放式的多总线结构 H地址总线经地址锁存、缓冲器(三态输出) ,数据总线经总线收发器,控制总线经总线控制逻辑之后形成的总线,称为系统总线。(连接主存储器和一般的 I/O 接口) HI/O 接口电路有一部分在主板上,另一部分通过总线插槽扩充。 32 位微处理器的外部引脚(教材 ) : D 63 ~D 0共64位奇偶校验信号: DP 7 ~DP 0 ,每个字节产生 1个校验位读校验错: PCHK Pentium 处理器的外部引脚 HA 31 ~A 3:高29位地址线 H BE 7 ~BE 0:字节允许信号(存储体选中信号) H外围电路对 BE 7 ~BE 0译码以产生 A 2 ~A 0 信号 Pentium 处理器的外部引脚 CLK 2. 可屏蔽中断请求 INTR 3. 非屏蔽中断请求 NMI 4. 系统复位信号 RESET 系统复位后,程序运行的地址为: FFFFFFF0H 实模式 CS: F000H, IP: 0FFF0H Pentium 处理器的外部引脚系统时钟是微处理器内部与外部操作的同步时基信号,由时钟( CLK )输入信号来提供。 CLK 时钟周期: T状态:就是指时钟周期 T Pentium 处理器的外部引脚 M/IO : =1, 表明该总线周期,CPU 与存储器交换信息=0, 表明该总线周期,CPU 与I/O 接口交换信息 W/R : =1, 表明该总线周期,CPU 进行写操作=0, 表明该总线周期,CPU 进行读操作 D/C : =1, 表明该总线周期,传输的是数据=0, 表明该总线周期,传输的是指令代码这三个信号的组合,决定当前总线周期所完成的操作 Pentium 处理器的外部引脚 (输出) “周期”是一段时间 CPU 通过总线与存储器、 I/O 交换一个数据所需要的时间称为总线周期总线周期定义的操作 M/IO D/C W/R 操作 0 0 0 中断 0 0 1 中止/专用周期 0 1 0 I/O 读 0 1 1 I/O 写 1 0 0 微代码读 1 0 1 保留 1 1 0 存储器读 1 1 1 存储器写 Pentium 处理器的外部引脚 ( ADS,RDY) 与32位微处理器典型时序(教材 ) H ADS :地址选通信号(输出)该信号由 1 →0,表明地址线和总线定义信号( M/IO,W/R,D/C )均为有效可用。 Pentium 处理器的外部引脚 H LOCK :总线锁定信号 LOCK=0 ,通知外围电路,不允许外部信号打断当前的总线周期。当一条指令有. LOCK 前缀时,该引脚输出为 0。

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