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硬件描述语言HDL的现状与发展
摘要：从数字系统设计的性质动身，结合目前快速进展的芯片系统，比较、讨论各种硬件描述语言；具体阐述各种语言的进展历史、体系结构和设计方法；探讨将来硬件描述语言的进展趋势，同时针对国内EDA基础薄弱的87。应当留意，起初VHDL只是作为系统规范的一个标准，而不是为设计而制定的。其次个版本是在1993年制定的，称为VHDL-93，增加了一些新的命令和属性。
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虽然有“VHDL是一个4亿美元的错误”这样的说法，但VHDL究竟是1995年以前唯一制订为标准的硬件描述语言，这是它不争的事实和优势；但同时它的确比较麻烦，而且其综合库至今也没有标准化，不具有晶体管开关级的描述力量和模拟设计的描述力量。目前的看法是，对于特大型的系统级数字电路设计，VHDL是较为合适的。
实质上，在底层的VHDL设计环境是由Verilog HDL描述的器件库支持的，因此，它们之间的互操作性非常重要。目前，Verilog和VDHL的两个国际组织OVI、VI正在筹划这一工作，预备成立特地的工作组来协调VHDL和Verilog HDL语言的互操作性。OVI也支持不需要翻译，由VHDL到Verilog的自由表达。
Verilog HDL
Verilog HDL是在1983年，由GDA（GateWay Design Automation）公司的Phil Moorby首创的。Phil Moorby后来成为Verilog-XL的主要设计者和Cadence公司的第一合伙人。在1984~1985年，Phil Moorby设计出了第一个名为Verilog-XL的仿真器；1986年，他对Verilog HDL的进展又作出了另一个巨大的贡献：提出了用于快速门级仿真的XL算法。
随着Verilog-XL
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算法的胜利，Verilog HDL语言得到快速进展。1989年，Cadence公司收购了GDA公司，Verilog HDL语言成为Cadence公司的私有财产。1990年，Cadence公司打算公开Verilog HDL语言，于是成立了OVI（Open Verilog International）组织，负责促进Verilog HDL语言的进展。基于Verilog HDL的优越性，IEEE于1995年制定了Verilog HDL的IEEE标准，即Verilog HDL 1364-1995；2021年发布了Verilog HDL 1364-2021标准。在这个标准中，加入了Verilog HDL-A标准，使Verilog有了模拟设计描述的力量。

Superlog
开发一种新的硬件设计语言，总是有些冒险，而且未必能够利用原来对硬件开发的阅历。能不能在原有硬件描述语言的基础上，结合高级语言C、C++甚至Java等语言的特点，进行扩展，达到一种新的系统级设计语言标准呢?
Superlog就是在这样的背景下研制开发的系统级硬件描述语言。Verilog语言的首创者Phil Moorby和Peter Flake等硬件描述语言专家，在一家叫Co-Design Automation的EDA公司进行合作，开头对Verilog进行扩展讨论。1999年，Co-Design公司发布了SUPERLOGTM系统设计语言，同时发布了两个开发工具：SYSTEMSIMTM和SYSTEMEXTM。一个用于系统级开发，一个用于高级验证。2021年，Co-Design公司向电子产业标准化组织Accellera发布了SUPERLOG扩展综合子集ESS，这样它就可以在今日Verilog语言的RTL级综合子集的基础上，供应更多级别的硬件综合抽象级，为各种系统级的EDA软件工具所利用。
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至今为止，已超过15家芯片设计公司用Superlog来进行芯片设计和硬件开发。Superlog是一种具有良好前景的系统级硬件描述语言。但是不久前，由于整个IT产业的滑坡，EDA公司进行大的整合，Co-Design公司被Synopsys公司兼并，形势又变得扑朔迷离。
SystemC
随着半导体技术的迅猛进展，SoC已经成为当今集成电路设计的进展方向。在系统芯片的各个设计中，像系统定义、软硬件划分、设计实现等，集成电路设计界始终在考虑如何满意SoC的设计要求，始终在查找一种能同时实现较高层次的软件和硬件描述的系统级设计语言。
SystemC正是在这种状况下，由Synopsys公司和CoWare公司乐观响应目前各方对系统级设计语言的需求而合作开发的。1999年9月27日，40多家世界闻名的EDA公司、IP公司、半导体公司和嵌入式软件公司宣布成立