基于FPGA的数字电路实验: 触发器电路
基本RS触发器:,用或非门组成,,Qn为状态变量;正常工作时输入信号应遵循SR=0的约束条件,即不允许输入S=R=1的信号;Qn为初态,Qn+1为次态;关系式为:
S R
Qn
Qn+1
0 0
0
0
0 0
1
1
1 0
0
1
1 0
1
1
0 1
0
0
0 1
1
0
1 1
0
0*
1 1
1
0*
* Sd,Rd的1状态同时消失后状态不定。
(a) 基本RS触发器框图
(b) 基本RS触发器逻辑图
基本RS触发器相关图形
同步RS触发器功能表
CP
S R
Qn
Qn+1
0
× ×
0
0
0
× ×
1
1
1
0 0
0
0
1
0 0
1
1
1
1 0
0
1
1
1 0
1
1
1
0 1
0
0
1
0 1
1
0
1
1 1
0
1*
1
1 1
1
1*
* CP回到低电平后状态不定。
同步RS触发器:,该电路由两部分组成:由与非门组成的基本RS触发器和由与非门组成的输入控制电路。。
(a) 同步RS触发器框图符号同步RS触发器逻辑图
同步RS触发器相关图形
主从JK触发器(JK_FF):,(a)(b)。特性方程为:
主从JK触发器的特性表
CP
J K
Qn
Qn+1
×
× ×
×
×
↑
0 0
0
0
↑
0 0
1
1
↑
1 0
0
1
↑
1 0
1
1
↑
0 1
0
0
↑
0 1
1
0
↑
1 1
0
1
↑
1 1
1
0
(a)JK触发器框图
(b)JK触发器逻辑图
D触发器功能表
D
Q
Qn+n1
0
0
0
0
1
0
1
0
1
1
1
1
*说明:电路图中出现的RDN为异步复位键,即当RDN=0时输出置零,与输入信号无关。
T触发器: 由JK触发器可构成T触发器,。
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