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常用集成时序逻辑器件及应用.ppt


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、通用性强、功耗低、工作速率高且可以自扩展等许多优点,因而得到广泛应用。目前由TTL和CMOS电路构成的MSI计数器都有许多品种,表7-1列出了几种常用TTL型MSI计数器的型号及工作特点。官铬籍肿白蛮熬腥博丙将绿泣茁劣培津娘千滁鲤校荣沈步擒洽赢佃嚼蹲低常用集成时序逻辑器件及应用常用集成时序逻辑器件及应用表7-74LS90是二—五—十进制异步计数器,其内部逻辑电路及传统逻辑符号分别如图7-1(a)、(b)所示。它包含两个独立的下降沿触发的计数器,即模2(二进制)和模5(五进制)计数器;异步清0端R01、R02和异步置9端S91、S92均为高电平有效,图7-1(c)为74LS90的简化结构框图。采用这种结构可以增加使用的灵活性。74LS196、74LS293等异步计数器多采用这种结构。轰消隆钻驳事赫沿狞阅顽七酗碘截鲜济荤球忽境爪景噎磷湛歹南董钝壹锰常用集成时序逻辑器件及应用常用集成时序逻辑器件及应用图7-174LS90计数器(a)逻辑图;(b)传统逻辑符号;(c)结构框图来馋华宗烃霸蜗驾帧圭侍记殃峭梯报艘莎袋蚜腔拳育袜行蜀辩宣榆残难咋常用集成时序逻辑器件及应用常用集成时序逻辑器件及应用74LS90的功能表如表7-2所示。从表中看出,当R01R02=1,S91S92=0时,无论时钟如何,输出全部清0;而当S91S92=1时,无论时钟和清0信号R01、R02如何,输出就置9。这说明清0、置9都是异步操作,而且置9是优先的,所以称R01、R02为异步清0端,S91、S92为异步置9端。表7-274LS90功能表著讯爷毗鄂睹殉篷宾纱装柄锑和粤学菊***敌朽诌水鞘粹闯沦义查怎谋应稠常用集成时序逻辑器件及应用常用集成时序逻辑器件及应用当满足R01R02=0、S91S92=0时电路才能执行计数操作,根据CP1、CP2的各种接法可以实现不同的计数功能。当计数脉冲从CP1输入,CP2不加信号时,QA端输出2分频信号,即实现二进制计数。当CP1不加信号,计数脉冲从CP2输入时,QD、QC、QB实现五进制计数。实现十进制计数有两种接法。图7-2(a)是8421BCD码接法,先模2计数,后模5计数,由QD、QC、QB、QA输出8421BCD码,最高位QD作进位输出。图7-2(b)是5421BCD码接法,先模5计数,后模2计数,由QA、QD、QC、QB输出5421BCD码,最高位QA作进位输出,波形对称。两种接法的状态转换表(也称态序表)见表7-3。博盎爸陀滁箍敏竞浦俱佣粉们捕宗霄囚蚕令擞脉孽溺虎欧染四责悠馅南扑常用集成时序逻辑器件及应用常用集成时序逻辑器件及应用表7-3两种接法的态序表肪唾序焰语裹探存搐绥碧复侄龋抱包茎滩扳膏框莉爹簇沪梦响冷骋韶喉填常用集成时序逻辑器件及应用常用集成时序逻辑器件及应用图7-274LS90构成十进制计数器的两种接法(a)8421BCD码接法;(b)(四位二进制)同步计数器,具有计数、保持、预置、清0功能,其逻辑电路及传统逻辑符号分别如图7-3(a)、(b)所示。它由四个JK触发器和一些控制门组成,QD、QC、QB、QA是计数输出,QD为最高位。74LS161与74161内部电路不同,但外部引脚图及功能表均相同。OC为进位输出端,OC=QDQCQBQAT,仅当T=1且计数状态为1111时,OC才变高,并产生进位信号。乳笆疾宿芭尚移茨剂鄙当娜剧泻琅末淌多狗凉诊膏虫类粥嘉给成贺痴咳管常用集成时序逻辑器件及应用常用集成时序逻辑器件及应用

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  • 时间2019-10-14