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多功能数字钟设计.ppt


文档分类:通信/电子 | 页数:约16页 举报非法文档有奖
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多功能数字钟设计.ppt多功能数字钟设计一、功能二、设计思路设计思路图多功能数字钟时钟信号生成部分计时功能报时功能闹表计时功能显示功能整点报时控制时钟计时1s时钟时计数器分计数器秒计数器时计数器分计数器比较器选择器1s时钟二分频输入时钟1024分频二十四进制计数器个位十位个位十位十进制六进制十进制六进制整点报时闹钟整点报时闹钟产生扫描信号与扫描信号配合时、分、秒选其一显示七段显示译码多路选择器计数器译码器小数点显示个位十位十进制六进制二十四进制计数器输入输出信号端输入信号:Scanclk:时钟信号;,计时实际需要1Hz, 程序中加有1024分频,故scanclk频率约为1024Hz。实现整点 报时声音控制Set:设置键;设定闹表定时时、分;计时时、分校准;用拨码开关, 拨上为定时,拨下为校准。Reset_in:异步复为信号;只对秒计时复位。adj_h_in,adj_m_in:时、分校准,闹钟定时控制close:止闹信号;闹钟响后,close为1止闹;用实验箱的拨码开关。输出信号:scanout::扫描信号;用于顺序点亮6个数码管。(用0—5位)led_out:七段数码管段码;高位为g。sound_out:声音输出接喇叭或峰鸣器。point_out:数码管间的点;隔两个数码管点亮一个。用实验箱的按键,按键按下为低电平。功能描述通用计数器:LIBRARYieee;;;ENTITYcounterISGENERIC(count_value:INTEGER:=9);PORT(clk,clr,en:INSTD_LOGIC;co :OUT STD_LOGIC;count:OUTINTEGERRANGE0TOcount_value);ENDcounter;ARCHITECTUREaOFcounterIS t:INTEGERRANGE0TOcount_value;BEGIN PROCESS(clk,clr) BEGIN IFclr='1't<=0; ELSIF(clk'EVENTANDclk='1')THEN IFen='1'THEN t=t<=0; t<=cnt+1; ENDIF; ENDIF; ENDIF; ENDPROCESS;co<='1't=count_valueelse'0'; count<=cnt;ENDa;数字钟的实体说明部分LIBRARYieee;;;entityTIMERisPORT( scanclk,reset_in,adj_h_in,adj_m_in,set,close:instd_logic; led_out:outstd_logic_vector(6downto0); scan_out:outintegerrange0to5; sound_out:outstd_logic; point_out:outstd_logic);endentity;architecturertlofTIMERisBeginEndrtl;定义语句区功能描述(并发描述语句)㈠时钟信号生成功能部分signalclk1s:std_logic;--t:std_logic_vector(9downto0);signaldy:std_logic;--整点报时控制时钟,50’’、52”、54”、56”、58”generat_1s_clock:PROCESS(scanclk) BEGIN IF(scanclk'EVENTANDscanclk='1')t<=cnt+1; ENDIF; clk1s<=cnt(9); --scanclk1024分频 ENDPROCESS; PROCESS(clk1s,reset) BEGIN IFreset='1'THEN dy<='0'; ELSIF(clk1s'EVENTANDclk1s='1')THEN dy<=notdy;--clk1s2分频, ENDIF; ENDPROCESS;㈡计时功能(用元件例化语句实现)C_sh_enC_ml_en1C_h_en1C_h_enC_ml_enC_mlC_hC_mh&&slshenablereset≥1≥1&clk1sdisable&Not(set)Adj_m&Not(set)Adj_henclkclrcoenclkclrcoenclkclrcoenclkclrcoenclkclrcocountcountcountcountcount&C_mh_en1C_mh_en㈡计时功能(用元件例化语句实现)signalreset,adj_h,adj_m:std_logic

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  • 上传人dyx110
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  • 时间2020-01-19