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计算机组成原理512×16位存储器课程设计报告.doc


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计算机组成原理512×16位存储器课程设计报告
目 录
第一章课设任务概述1

课设任务1
第二章课设容2




第三章个人总结10
主要结论10
对课设的认识10
参考文献11
第一章 课设任务概述

通过课设,掌握计算机系统软硬件维护的方法,并能利用所学知识,完成课设容。
课设任务
参考给出的或者课本上的计算机的硬件(应有中断功能)组成,写出给定的指令格式的指令的执行流程;
设计存储器。按要求拓展存储器,并画出其各个引脚与CPU的连线。要求用128K×16位的SRAM芯片设计512K×16位的存储器,SRAM芯片有两个控制端:当 CS 有效时该片选中。当W/R=1时执行读操作,当W/R=0时执行写操作。用64K×16位的EPROM芯片组成128K×16位的只读存储器。
设计计算机运算器(包括逻辑框图与指令系统,以及各指令的微程序流程图)
了解计算机的硬件系统。就计算机的某些硬件组成部分,说明对其认识。
简单的类MIPS多周期流水线处理器的实现实验。
第二章 课设容

(应有中断功能)组成,写出完成下面给定的指令格式的指令的执行流程;
(1)完成“异或”运算
“异或” 指令的指令格式
操作码 DR SR
启动
PC->AR->ABUS
DBUS->DR->IR
PC+1->PC
译码或测试
IR->AR->ABUS
DBUS->DR->ALU
DBUS->SR->ALU
ALU->AC
DBUS->DR

操作码DR SR
启动
PC->AR->ABUS
DBUS->DR->IR
PC+1->PC
译码或测试
IR->AR->ABUS
DBUS->SR->DR
(存数)指令执行流程,其指令格式如下:
助记符机器指令码说明
③STA addr 0010 0000 ×××× R0à [addr]
启动
PC->AR->ABUS
DBUS->DR->IR
PC+1->PC
译码或测试
IR->AR->ABUS
R0->DR
DR->DBUS

要求用128K×16位的SRAM芯片设计512K×16位的存储器,SRAM芯片有两个控制端:当 CS 有效时该片选中。当W/R=1时执行读操作,当W/R=0时执行写操作。用64K×16位的EPROM芯片组成128K×16位的只读存储器。试问:。
数据寄存器多少位?
地址寄存器多少位?
共需多少片EPROM?
画出此存储器组成框图。
<1>数据寄存器需要16位;
<2>地址寄存器需要20位,其中只读存储器需要地址线16位其中有一位为1:2译码器;SRAM组成的512K*16的存储器需要19位地址线,且与只读存储器共用A0~A15这16根地址线,其中A18,A19两根组成2:4译码器。
<3>共需要EPROM2片。
各个芯片与CPU 的连线如下:
1
2
3
0
1
CS
W/R
CS
W/R
A19
A18

A17
C
A16
P
A15

A0
U
W/R
D0

D15
CS
128K*16
SRAM
W/R
CS
128K*16
SRAM
W/R
CS
128K*16
SRAM
W/R
CS
128K*16 SRAM
W/R
2:4译码器
1:2译码器
0
3

设计计算机运算器(包括逻辑框图与指令系统,以及各指令的微程序流程图)


S3
S2
S1
S0
M

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  • 时间2021-06-21