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62..端口说明端口说明 port
提供::设计实体和其外部环境的动态通信通道设计实体和其外部环境的动态通信通道。
格式:
port (端口名:端口通讯恧模式 数据类枑型;
端口名:端口通讯恧模式 数据类枑型) ;
端口名: 端口的标识符;
端口通信模式: 说明数据通过该端口的流动方向;
数据类型: 说明经过该端口的数据类型。
7(1))端口名端口名
端口名是赋予每个引脚的名称,,通常由字母通常由字母、
数字和下划线组成,,并且要遵循下面的命名规则并且要遵循下面的命名规则:
① 第一个字符必须是字母 ;
② 不区分大小写 ;
③ 下划线不能连用 ;
④ 最后一个字符不能是下划线;
⑤ 命名不能与保留字一样 。
如两输入或门的端口名:
port (a: in bit;
a c
b ≥1 b: in bit;
c: out bit); 为 a, b, c
8(2))端口通信模式端口通信模式
定义外部接口是输入还是输出
in — 端口输入
端口通讯恧 out — 端口输出
模式 inout — 双向端口
buffer — 输出 (可反馈给构造体内用)
buffer
q
a & d
in qn out
clk
9(3))端口数据类型端口数据类型
程序包
所给定的、、由由EDA 工具支持和提供的标准逻辑类型:
std_logic ((位位位)) ‘0’, ‘1’
std_logic_vector (位向量柎))一惊组数一惊组数
另一种
bit ((位位位)) ‘0’, ‘1’ 不调用ieee 库时用
bit_vector (位向量柎))一惊组数一惊组数
10 : .
第第 11 章章章
超高速集成电路硬件描述语言超高速集成电路硬件描述语言超高速集成电路硬件描述语言超高速集成电路硬件描述语言超高速集成电路硬件描述语言超高速集成电路硬件描述语言超高速集成电路硬件描述语言超高速集成电路硬件描述语言
( VHDL )
Very high speed integrated circuit
Hardware Description Language
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