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试验十Moore型同步时序逻辑电路的分析与设计.docx
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通信/电子
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试验十Moore型同步时序逻辑电路的分析与设计.docx
实验十Moore型同步时序逻辑电路的分析与设计
一、实验目的
.掌握同步时序逻辑电路的分析、设计方法;
.掌握时序逻辑电路的测试方法。
二、实验原理
:
时序逻辑电路的分析,按照电路图,实验十Moore型同步时序逻辑电路的分析与设计
一、实验目的
.掌握同步时序逻辑电路的分析、设计方法;
.掌握时序逻辑电路的测试方法。
二、实验原理
:
时序逻辑电路的分析,按照电路图,选择芯片,根据芯片管脚, 在逻辑图上标明管脚号;大街电路后,根据电路要求输入时钟信号, 要求出电路的状态转换图或时序图,从中分析出电路的功能。
.Moore型同步时序逻辑电路的设计方法:
(1)分析题意,求出状态转换图。
(2)状态化简:确定等价状态,电路中的等价状态可合并为一 个状态。
(3)重新确定电路状态数N,求出触发器数你n,触发器数按下 列公式求:2n-1<N<2n (N为状态数,n为触发器数)。
(4)触发器类型(D> JK)。
(5)状态编码,列出状态转换表,求状态方程、驱动方程。
(6)画出时序电路图。
(7)时序状态检验,当N<2n时,应进行空转检验,以免电路进
入无效状态而不能自启动
(8)功能仿真、时序仿真。
3,同步时序逻辑电路的设计举例:
试用D触发器设421码模5加法计数器。
(2)状态转换化简:由题意得该电路无等价状态。
(3)确定触发器数:根据,2n-1<N <2n, n=3。
(4)触发器选型:选择D触发器。
(5)状态编码:Q3 Q2 Q1按421码规律变化.
(6)列出状态转换表,如表1.
*1
1模514却码)
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0
I
1 一」 tzj
x
X
X
(7)利用卡诺图如图2,求状态方程、驱动方程。
(9)画出逻辑图,如图4所示
(8)自启动检验:将各无效状态代入状态方程,分析状态转换情况,
画出完整的状态转换图,如图3所示,检查是否能自启动
用4同步稳5f心I码)加法计敷器电踏
三、实验仪器
1 .示波器1台
陵上填3^21码)加法计已静日启新相骑
用工然SHH SI加窿计歌题*雄囹)
由 a
四、实验内容
.模5 (421码)加法计数器功能检验:
按图4搭接电路,Cp接单脉冲P+, Q3Q2Q分别接逻辑指示灯
L3L2L1, Rd'接逻辑开关K12, Sd1'、SdZ、Sd3'分别接逻辑开
关K1、K2、K3;接通电源后,利用Rd'使计数器复位后,加单脉冲, 观察计数器工作情况,写出时序表,各无效状态利用SdT、SdZ、
Sd3'置数后,加单脉冲观察其次态,画出完整状态转换图;
实验得模5 (421码)加法计数器时序表
-n
Q
-n
Q
-n
Q
-n+1
Q
-n+1
Q
-n+1
Q
Y
0
0
0
0
0
1
0
0
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1
0
1
0
0
0
1
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0
1
1
0
0
1
1
1
0
0
0
1
0
0
0
0
0
1
其他
X
X
X
X
X
.模5 (421码)加法计数器时序图观测:
Cp Q3
将Cp接TTL信号(f=10kHz),用双踪示波器观察并记录
Q2、Q1波形。
实验示波器显示波形图如下:
黄色为Cp,
绿色为Q1
黄色为Cp,绿色为Q2
黄色为Cp,绿色为Q3
所以得最后整理波形图如下:
CU
0
0 4 I
0
%
0
.设计模10 (5421BCD加法计数器。
(1)分析题意:状态转换图如下:
(2)状态化简:无等价状态。
(3)确定触发器数:由24-1<10<24, n=4,所以要四个触发器。
(4)触发器类型:选择D触发器。
(5)状态编码,Q4 Q、Q、Q按5421码规律变化,得状态转换表如
下:
Qn
Qn
Qn
Qn
Qn+1
Qn+1
Qn+1
Qn+1
D4
口
D2
D
Y
试验十Moore型同步时序逻辑电路的分析与设计 来自淘豆网www.taodocs.com转载请标明出处.
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