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EDA_MaxplusII使用介绍.doc


文档分类:汽车/机械/制造 | 页数:约22页 举报非法文档有奖
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MAX+Plus II 应用简介§1概述 Max+plus Ⅱ是 Altera 公司提供的 FPGA/CPLD 开发集成环境, Altera 是世界上最大可编程逻辑器件的供应商之一。 Max+plus Ⅱ界面友好,使用便捷,被誉为业界最易用易学的 EDA 软件。在 Max+plus Ⅱ上可以完成设计输入、元件适配、时序仿真和功能仿真、编程下载整个流程, 它提供了一种与结构无关的设计环境, 是设计者能方便地进行设计输入、快速处理和器件编程。 Max+plus Ⅱ开发系统的特点 1 、开放的界面 Max+plus Ⅱ支持与 Cadence , Exemplarlogic , Mentor Graphics , Synplicty , Viewlogic 和其它公司所提供的 EDA 工具接口。 2 、与结构无关 Max+plus Ⅱ plier 支持 Altera 公司的 FLEX10K 、 FLEX8000 、 FLEX6000 、 MAX9000 、 MAX7000 、 MAX5000 和 Classic 可编程逻辑器件,提供了世界上唯一真正与结构无关的可编程逻辑设计环境。 3 、完全集成化 Max+plus Ⅱ的设计输入、处理与较验功能全部集成在统一的开发环境下, 这样可以加快动态调试、缩短开发周期。 4 、丰富的设计库 Max+plus Ⅱ提供丰富的库单元供设计者调用,其中包括 74 系列的全部器件和多种特殊的逻辑功能( Macro-Function )以及新型的参数化的兆功能( Mage-Function )。 5 、模块化工具设计人员可以从各种设计输入、处理和较验选项中进行选择从而使设计环境用户化。 6 、硬件描述语言( HDL ) Max+plus Ⅱ软件支持各种 HDL 设计输入选项, 包括 VHDL 、 Verilog HDL 和 Altera 自己的硬件描述语言 AHDL 。 7、 Opencore 特征 Max+plus Ⅱ软件具有开放核的特点,允许设计人员添加自己认为有价值的宏函数。§2 Max+plus Ⅱ功能简介 1 、原理图输入( Graphic Editor ) MAX+PLUSII 软件具有图形输入能力, 用户可以方便的使用图形编辑器输入电路图, 图中的元器件可以调用元件库中元器件, 除调用库中的元件以外, 还可以调用该软件中的符号功能形成的功能块. 图形编辑器窗口见图(一)。 2 、硬件描述语言输入( Text Editor ) MAX+PLUSI I 软件中有一个集成的文本编辑器, 该编辑器支持 VHDL,AHD L和 Verilo g 硬件描述语言的输入, 同时还有一个语言模板使输入程序语言更加方便, 该软件可以对这些程序语言进行编译并形成可以下载配置数据,文本编辑器窗口见图(二)。 3、波形编辑器(W aveform Editor) 在进行逻辑电路的行为仿真时, 需要在所设计电路的输入端加入一定的波形, 波形编辑器可以生成和编辑仿真用的波形(*. SCF 文件), 使用该编辑器的工具条可以容易方便的生成波形和编辑波形。波形编辑器窗口如图(三) 所示。使用时只要将欲输入波形的时间段用鼠标涂黑, 然后选择工具条中的按钮,例如,如果要某一时间段为高电平,只需选择按钮”1”。还可以使用输入的波形(*.WDF 文件) 经过编译生成逻辑功能块,相当于已知一个芯片的输入输出波形, 但不知是何种芯片, 使用该软件功能可以解决这个问题, 设计出一个输入和输出波形相同 CPLD 电路。 4、管脚(底层)编辑窗口(Floorplan Editor) 该窗口用于将已设计好逻辑电路的输入输出节点赋予实际芯片的引脚, 通过鼠标的拖拉, 方便的定义管脚的功能。管脚(底层)编辑窗口见图(四)。 5、自动错误定位在编译源文件的过程中, 若源文件有错误, Max+Plus2 软件可以自动指出错误类型和错误所在的位置。 6、逻辑综合与适配该软件在编译过程中, 通过逻辑综合(Logic Synthesizer) 和适配(Fitter) 模块, 可以把最简单的逻辑表达式自动的吻合在合适的器件中。 7、设计规则检查 pile\Processing\ D esign Doctor 菜单,将调出规则检查医生,该医生可以按照三种规则中的一个规则检查各个设计文件, 以保证设计的可靠性。一旦选择该菜单, 在编译窗口将显示出医生,用鼠标点击医生,该医生可以告诉你程序文件的健康情况。见图(五)。图三波形编辑器窗口图一图形编辑器窗口图二文本编辑器窗口图四管脚(底层)编辑窗口 8、多器件划分(Partitioner) 如果设计不能完全装入一个器件,编译器中的多器件划分模块,可自动的将一个设计分成几个部分并分别装入几个器件中,并保证器件之间的连线最少。

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  • 时间2017-02-24