使用IBIS模型进行时序仿真.pdf

光电通讯网 www . m . com 丰富的开发资源,丰富的技术交流,硬件设计者的网上家园使用 IBIS 模型进行时序仿真光电通讯网出品光电通讯网 www . 丰富的开发资源丰富的技术交流硬件设计者的网上家园 2004-07-05 光电通讯网 www . m . cpm 丰富的开发资源,丰富的技术交流,硬件设计者的网上家园 2004-7-1 光电通讯网 www . m . com 丰富的开发资源,丰富的技术交流,硬件设计者的网上家园 1 介绍 DPS 和 me m o r i e s 的测试参数在各自的 dat a sh ee t 给出, 测试是在 dat a sheet 里给出的条件下进行的, 而任何测试条件的变化都会引起参数的变化。测试条件包括温度, 电压, 频率, 负载电容, 阻抗等等。 IBIS 模型是一种在所有处理条件下对输入输出口行为进行建模的快速而精确的办法。 IBIS 模型建立在电压- 电流曲线的基础上, 曲线来自于全面的电路仿真和( 或) 顶层测试. 要想用 IBIS 模型, 仿真工具是必须购买的, 比如 Hyp e rlyn x 或 M e nt o r Grap hi cs 公司的。这些仿真工具能给出在系统级, 板级, 或元件级的精确的信号完整性分析。比如,DSP 测试系统给出了一个测试负载. 如果一块电路板与测试系统比有更多或更少的负载, 时序就会比最初预想的不一致. 这会对系统产生危害还是好处, 取决与是怎样的不一致和哪些参数是所关心的。本文所关心的是阻抗和负载。所以假定频率, 电压保持在 DA T A SHEET 里规定范围内, 而温度是室温。使用多个占全总线位宽的 SDRAM 的系统必须对每个器件进行 IBIS 仿真。这样做的原因是 DSP 与 SDRAM 直接不再是点对点的连接。走线长度的变化造成了不同器件之间时序的不同。用户必须进行 IBIS 仿真来确保信号完整性。本文说明了不同的时序参考点对 DS P 和 SDRA M 是同样重要的。在第 3 节,可以看到 DSP 和 SDR A M 在测试系统中和在标准板上不同的时序表现。参考电压和噪声同时影响了测试系统和标准板的时序。如何理解现象发生的原因在第 4 节和第 5 节有简单讨论。第 6 节是应用报告,围绕着基于 IBIS 仿真的建立与保持时间的公式展开。第 7 节总结了 AC 时序分析的步骤。 2 建立参考点 DA T A SHEE T 的时序数据是管脚上测出来的,管脚连在有测试负载的测试板上。在实际的电路板上, 时序随着电路板与测试板相比的负载的变化而变化。在研究测试板与实际电路板之间差别的细节之前, 本节先讨论如何建立参考点。当一个与测试板不同的电路板在建模的时候,参考点是必须建立的。为方便起见,参考点通常设在主器件上,那就是 DSP 。参考点表示时间从 DSP 的输出管脚上开始计算。图 1 表示了一个 DSP 在真实的电路板上是怎样向 SDRAM 写数的。 t0 表示时间原点。 ABCDE 分别是在 DSP 和 SDRAM 上的测试点。 F 点表示输出 BUFFER 打开时相对与 t0 的点。 Xn 是内部时延,这 DSP 来说是固定的常数。假设 Xn 的值为- 。同样假设 A 点的输出 BUFFER 有 0. 2n s 的内部延时, D 点的有 n s 内部延时。可以算出 A 点为( t0+ 0 .2 ) ns ,即比 t0 延时 0. 2ns;D 点为( t0+X n + 0. 3 ) ns =( t0 - 3. 1+ ) ,延时- 。 DSP 的输出建立时间指数据传输到 D 的时间与时钟传输到 A 的时间之差。在这个例子中,输出建立时间为【 - ( - ) 】 ns = 3ns 。光电通讯网 www . m . cpm 丰富的开发资源,丰富的技术交流,硬件设计者的网上家园 2004-7-1 光电通讯网 www . m . com 丰富的开发资源,丰富的技术交流,硬件设计者的网上家园图 1 计算保持时间时 Xn 是不同的, 因为使用的不同的内部逻辑门来构成 BUFFER 。在 DS P 读数据的时候, DSP 输出时钟, 控制和地址信号, 如图 1 所示。在收到读命令后, SDRAM 输出数据。图 2 显示了 SD R A M 如何在 DSP 输出时钟的下送出数据的。 Yn 为 SDRAM 的内部时延。 SD RAM 的输入输出时序与已到器件管脚的时钟信号有关系。比如, SDRA M 的输出保持时间开始于在 B 点的时钟信号超过给定的参考电压 Vr